使用Cyclone IV控制DDR2

根据你的DDR2手册配置好megacore,megacore会生成一个example top;

在quartus中运行megacore生成的xxx_pin_assignments.tcl,指定DDR2 Pin的IO Standard;

在Pin Planner中将DDR2引脚指定到side,或指定到bank,或指定好DQS Pin,还可以顺便指定好CK/CK# Pin;

CK/CK#不能和用到的DQ/DQS在同一Pin group,pin group信息可以在Pin Planner中的芯片图四周查看;

确认编译message中没有critical warning;

layout时不要使用quartus没有自动分配上的Pin,因为除了一般性的DQ/DQS等规则外还有其他一些我们不知道的规则;

同一DQS组内的各DQ可以任意交换;各DQS组可以整体交换;CTL Pin可以任意交换。

再次强调,编译message不能有critical warning。

时间: 2024-10-29 06:35:58

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1. 逻辑单元 (LE) 在 Cyclone IV 器件结构中是最小的逻辑单位.LE 紧密且有效的提供了高级功能的逻辑使用.每个 LE 有以下特性:一个四口输入的查找表 (LUT),以实现四种变量的任何功能一个可编程的寄存器一个进位链连接一个寄存器链连接可驱动以下的相互连接:本地.行.列.寄存器链.直联. 2. 看下图,可以对每个 LE 配置可编程的寄存器为 D. T. JK, 或 SR 触发器操作.每个寄存器上有数据,时钟,时钟使能和清零输入.全局时钟网络,通用 I/O 管脚,任何内部逻辑都可

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